Xilinx IP 10G Ethernet PCS/PMA IP Core

Vivado 10G Ethernet PCS/PMA介绍

1介绍

完整的10G以太网接口如下图,分为10G PHY和10G MAC两部分。
在这里插入图片描述
这篇文章重点讲 10G Ethernet PCS/PMA。

2 IP的基本介绍

10G以太网物理编码子层/物理介质连接(PCS/PMA)核心在Xilinx 10G以太网介质访问控制器(MAC)核心和具有10Gb/s能力的PHY之间形成了无缝接口,实现了高速以太网系统和子系统的设计。

•根据万兆以太网规范设计IEEE标准802.3-2012第49、72、73、74条
•管理PCS/PMA寄存器的可选管理数据接口(MDIO)
•支持Zynq-7000、UltraScale中的10GBASE-SR、-LR和-ER光链路™, Virtex-7和Kintex-7设备(仅限LAN模式)
•支持UltraScale和Virtex-7设备中的10GBASE-KR背板链路,包括自动协商(AN)、训练和前向纠错(FEC)
•万兆以太网媒体独立接口(XGMII)与Xilinx万兆以太网MAC无缝连接
•10GBASE-R标准提供64位或32位数据宽度选项。10GBASE-KR标准始终提供64位数据宽度

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